已有 5774 次阅读| 2011-12-14 12:54 |个人分类:verilog语言
最近看XILINX的参考设计,遇到一些verilog优先级问题,现在总结一下!
* / %最高优先级
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<< >>
>= < <=
== != === !==
&
^ ^~
|
&& 最低优先级
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